JEDEC正式发布LPDDR6内存标准，旨在显著提升移动设备和AI应用的性能、能效及安全性。LPDDR6采用双子通道架构，提供更灵活的操作和更高的带宽。在能效方面，通过降低电压和采用双电源供电，以及多种节能特性，实现功耗的进一步降低。安全性方面，LPDDR6引入了多项增强措施，如每行激活计数、预留元模式和ECC纠错校验等，提升数据完整性和系统可靠性。多家半导体厂商表达了对LPDDR6的支持，预计搭载LPDDR6的移动设备将在下半年面世。

🚀 **双子通道架构与灵活操作：** LPDDR6采用双子通道架构，每个裸片支持两个子通道，每个子通道包含12个数据信号线和4个指令/寻址指令，优化了通道性能，并减少焊球数量，从而改进数据访问速度。

💡 **卓越的能效表现：** LPDDR6通过降低电压和采用双电源供电，并支持交替时钟命令输入、低功耗动态电压频率调整（DVFSL）等技术，实现了能效的显著提升，有助于延长设备续航时间。

🛡️ **增强的安全性和可靠性：** LPDDR6引入了每行激活计数、预留元模式、可编程链路保护机制、ECC纠错校验、命令/地址奇偶校验、错误擦洗、寸内自测试等功能，全面提升了内存的数据完整性和系统可靠性。

🚄 **惊人的数据传输速率：** 虽然JEDEC未明确规定LPDDR6的数据传输率，但根据此前说法，其起步就超过10Gbps，最高可达14400Mbps，远超LPDDR5和LPDDR5X，带来更快的运行速度。

JEDEC今天正式发布了LPDDR6内存标准，规范编号JESD209-6，可显著提升移动设备、AI应用的性能、能效、安全。性能方面，LPDDR6采用双子通道架构，保持最小访问间隔32字节的同时，允许更灵活的操作。

1、每颗裸片(Die)支持两个子通道，每个子通道分为12个数据信号线(DQ)，优化通道性能。

2、每个子通道包含4个指令/寻址(CA)指令，优化减少焊球数量，改进数据访问速度。

3、支持静态能效模式，可支持更大容量，最大化利用bank资源。

4、支持弹性数据访问，实时突发长度控制，支持32/64字节访问。

5、支持动态写入NT-ODT(非目标片上终止)，可以根据负载需求调整ODT，改进信号完整性。

不过，JEDEC并未规定LPDDR6的数据传输率(频率)，根据此前说法起步就超过了10Gbps，可以达到10667Mpbps，而最高可以做到14400Mbps，也可以说是14.4GHz。

相比之下，LPDDR5起步为6400Mbps，LPDDR5X提升至8533Mpbs，SK海力士自己做的LPDDR5T则能跑到9600Mbps。

能效方面，LPDDR6进一步降低了电压和功耗，采用VDD2供电，并且采用双电源供电。

其他节能特性还有：

1、交替时钟命令输入，提高性能和能效。

2、低功耗动态电压频率吊证(DVFSL)，在低频率运行时减少VDD2供电，从而节省功耗。

3、动态效率模式，采用单个子通道接口，适合低功耗、低带宽场景。

4、支持部分自刷新、主动刷新，降低刷新功耗。

安全性和可靠性方面，LPDDR6也有了很大的提升。

1、支持每行激活计数(PRAC)，支持内存数据完整性。

2、支持预留元模式(Carve-Out Meta)，通过为关键任务分配特定内存区域，提高整体系统可靠性。

3、支持可编程链路保护机制、ECC纠错校验。

4、支持命令/地址(CA)奇偶校验、错误擦洗、寸内自测试(MBIST)，以增强错误检测能力和系统可靠性。

Advantest、Cadence、Synopsys、三星、SK海力士、美光、高通、联发科等半导体测试厂商、内存芯片厂商、终端厂商都表达了对LPDDR6的支持和期待。

至于LPDDR6内存何时落地，估计就看下半年的新一代骁龙、天玑平台了！